LTC1877是一款采用恒定频率、电流模式架构的高效单片同步降压稳压器。运行期间的电源电流仅为10μA，停机时降至<1μA。2.65V至10V的输入电压范围使LTC1877非常适合单锂离子电池和双锂离子电池供电的应用。100%占空比提供低压差操作，延长便携式系统的电池寿命。开关频率内部设置为550kHz，允许使用小型表面贴装电感器和电容器。对于对噪声敏感的应用，LTC1877可以从400kHz到700kHz进行外部同步。同步期间或SYNC/Mode引脚拉低时，突发模式操作被禁止，防止低频纹波干扰音频电路。内部同步开关提高了效率，并消除了对外部肖特基二极管的需求。0.8V反馈参考电压很容易支持低输出电压。LTC1877采用节省空间的8引脚MSOP封装。特性高效：高达95%极低静态电流：运行时仅10μAVIN=5V时的600mA输出电流2.65V至10V输入电压范围550kHz恒定频率操作无需肖特基二极管低压差操作：100%占空比可从400kHz同步到700kHz可选突发模式®操作或脉冲跳过模式0.8V参考允许低输出电压关机模式消耗<1μA的电源电流±2%输出电压精度电流模式控制实现出色的线路和负载瞬态响应过电流和过热保护提供8导联MSOP封装应用行动电话无线调制解调器个人信息设备便携式仪器分布式电力系统电池供电设备
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2026/8/20 15:42:20
LTC3401是一种高效、固定频率、升压DC/DC转换器，可在低于1V的输入电压下运行。该器件包括一个0.16ΩN沟道MOSFET开关和一个0.18ΩP沟道同步整流器。高达3MHz的开关频率由外部定时电阻器编程，振荡器可以与外部时钟同步。外部肖特基二极管是可选的，但会略微提高效率。在突发模式下，静态电流仅为38μA，可最大限度地延长便携式应用的电池寿命。突发模式操作由用户控制，可以通过将Mode/SYNC引脚驱动到高电平来启用。如果MODE/SYNC引脚有时钟或被驱动为低电平，则启用固定频率切换。其他功能包括1μA关机、防锈控制、开漏电源良好输出、热关机和电流限制。LTC3401采用10引脚热增强MSOP封装。高电流应用应使用2A额定LTC3402同步升压转换器。需要VOUT<2.6V的应用程序应使用LTC3423。特性同步整流：效率高达97%1A开关电流额定值固定频率运行高达3MHz宽输入范围：0.5V至5.5V（工作）极低静态电流：38μA（Burst Mode®操作）2.6V至5.5V可调输出电压0.85V（典型）启动电压无需外部肖特基二极管（VOUT<4.3V）可同步开关频率突发模式启用控制防振铃控制降低开关噪声PGOOD输出OPTI-LOOP®补偿极低关断电流：<1μA小型10针MSOP封装应用寻呼机手持式仪器无绳电话无线手机GPS接收机备用电池
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2026/8/20 15:36:09
由于AD7191上的模拟输入和参考输入是差分的，因此模拟调制器中的大多数电压都是共模电压。该部件出色的共模抑制能力消除了这些输入上的共模噪声。AD7191的模拟和数字电源是独立的，并且是单独固定的，以尽量减少设备模拟和数字部分之间的耦合。AD7191可以使用5V模拟和3V数字电源运行，反之亦然。数字滤波器可抑制电源上的宽带噪声，调制器采样频率的整数倍除外。模拟输入上的一个简单的R-C低通滤波器可以抑制时钟频率上的任何干扰。数字滤波器还可以从模拟和参考输入中去除噪声，前提是这些噪声源不会使模拟调制器饱和。因此，AD7191比传统的高分辨率转换器更不受噪声干扰。然而，由于AD7191的分辨率如此之高，而AD7191的噪声水平如此之低，因此必须注意接地和布局。印刷电路板的设计应使模拟和数字部分分开并限制在电路板的某些区域。这便于使用易于分离的接地平面。最小蚀刻技术通常最适合接地平面，因为它提供了最佳的屏蔽。尽管AD7191具有用于模拟和数字接地的单独引脚，但AGND和DGND引脚通过基板在设备内连接在一起。除非接地平面在AD7191附近连接在一起，否则用户不得将这些引脚从外部绑在单独的接地平面上。避免在设备下方运行数字线路，因为这些线路会将噪声耦合到芯片上。应允许模拟接地平面在AD7191下运行，以防止噪声耦合。AD7191的电源线应使用尽可能宽的迹线，以提供低阻抗路径并减少电源线上的毛刺影响。时钟等快速开关信号应使用数字接地屏蔽，以避免向电路板的其他部分辐射噪声，时钟信号不应在模拟输入附近运行。避免数字和模拟信号的交叉。电路板两侧的迹线应相互垂直。这减少了电路板馈通的影响。微带技术是迄今为止最好的，但对于双面板来说并不总是可能的。在这种技术中，电路板的元件侧专用于接地平面，信号放置在焊料侧。使用高分辨率ADC时，良好的解耦非常重要。所有模拟电源应与10μF钽电容器并联，与AGN...
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2026/8/20 15:30:48
AD7191是一款低噪声、完整的模拟前端，适用于高精度测量应用。它包含一个低噪声、24位∑-ΔADC。片上低噪声增益级意味着小幅度的信号可以直接连接到ADC。它包含两个差分模拟输入。该部件还包括可用于温度补偿的温度传感器。为了便于使用，AD7191的所有功能都由专用引脚控制。片上PGA的增益为1、8、64或128，支持±5 V、±625 mV、±78 mV或±39 mV的满标度差分输入。输出数据速率可编程为10 Hz、50 Hz、60 Hz或120 Hz。当输出数据速率设置为10Hz或50Hz时，可以同时实现50Hz和60Hz的抑制；当输出数据速率设置为60Hz时，仅获得60Hz的抑制。AD7191可以使用内部时钟操作，也可以使用外部时钟。该部件在3 V至5.25 V的电源下工作。它消耗4.35 mA的电流。它采用24导联TSSOP封装。特性引脚可编程输出速率输出数据速率：10 Hz、50 Hz、60 Hz、120 Hz引脚可编程PGA增益：1、8、64、128引脚可编程断电和复位RMS噪声：10 Hz时为15 nV（增益=128）高达21.5个无噪声位（增益=1）内部或外部时钟桥式断电开关偏移漂移：5 nV/°C增益漂移：1ppm/°C随时间变化的指定漂移同时抑制50 Hz/60 Hz内部温度传感器电源：3 V至5.25 V电流：4.35mA温度范围：-40°C至+105°C
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2026/8/20 15:24:06
ADRF5702是一款8位数字衰减器，衰减范围为31.875dB，步长为0.125dB，采用绝缘体上硅（SOI）工艺制造。该器件工作频率为50MHz至20GHz，插入损耗低于2.6dB，衰减精度极佳。ADRF5702对ATTIN引脚的所有状态具有27dBm平均和29dBm峰值的RF输入功率处理能力。ADRF5702需要5V或3.3V的单电源电压。除电气规格部分给出的值外，该设备不支持电源中间电压水平。该器件具有串行或并行模式控制和互补金属氧化物半导体（CMOS）/低压晶体管到晶体管逻辑（LVTTL）兼容控制。ADRF5702射频端口设计用于匹配50Ω的特性阻抗Ω.ADRF5702采用24端子、4.0mm×4.0mm的焊盘栅格阵列（LGA）封装，可在-40°C至+105°C的温度范围内运行。其具备的特性主要如下：•频率范围：50MHz至20GHz•衰减范围：31.875dB，步长为0.125dB•插入损耗低•高达6GHz的典型1.4dB（5V电源）•1.8dB典型值高达12GHz（5V电源）•2.6dB典型值高达20GHz（5V电源）•衰减精度：−（衰减状态的0.1+2.0%），通常高达20GHz•阶跃误差：在20GHz（5V电源）以下通常为-0.30dB•高线性•输入P0.1dB•衰减状态<8dB:32dBm典型值（5V电源）•衰减状态≥8dB:29dBm典型值（5V电源）•输入IP3•衰减状态<16dB）：典型值为55dBm（5V电源）•衰减状态≥16dB）：典型50dBm（5V电源）•高射频功率处理•平均27dBm（ATTIN）•峰值32dBm（5V电源，衰减状态<8dB）•29dBm峰值（5V电源，衰减状态≥8dB）•27dBm热切换•射频振幅稳定时间（50%触发控制至最终射频输出的0.05dB）...
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2026/8/20 15:17:06
可以通过查看负载电流瞬态响应来检查调节器回路响应。开关稳压器需要几个周期来响应直流（电阻性）负载电流的阶跃。当发生负载阶跃时，VOUT的偏移量等于ΔILOAD（ESR），其中ESR是COUT的有效串联电阻。ΔILOAD也开始对COUT进行充电或放电，产生反馈误差信号，迫使调节器适应电流变化，并将VOUT恢复到其稳态值。在此恢复时间期间，可以监测VOUT是否存在过度过冲或振铃，这将表明存在稳定性问题。OPTI-LOOP补偿允许在宽范围的输出电容和ESR值上优化瞬态响应。ITH引脚的可用性不仅可以优化控制回路行为，还可以提供直流耦合和交流滤波的闭环响应测试点。该测试点的直流阶跃、上升时间和稳定真实地反映了闭环响应。假设主要是二阶系统，则可以使用该引脚处的过冲百分比来估计相位裕度和/或阻尼因子。带宽也可以通过检查引脚的上升时间来估计。图1电路所示的ITH外部组件将为大多数应用提供足够的起点。ITH系列RC-CC滤波器设置了主导极点零环补偿。一旦完成最终的PC布局和特定的输出电容器类型和值，可以稍微修改这些值以优化瞬态响应已经确定。需要选择输出电容器，因为各种类型和值决定了环路增益和相位。具有1μs至10μs上升时间的满载电流的20%至80%的输出电流脉冲将产生输出电压和ITH引脚波形，这将在不破坏反馈回路的情况下提供整体回路稳定性的感觉。将功率MOSFET直接跨接在输出电容器上并用适当的信号发生器驱动栅极是产生真实负载阶跃条件的实用方法。由输出电流的阶跃变化引起的初始输出电压阶跃可能不在反馈回路的带宽内，因此该信号不能用于确定相位裕度。这就是为什么最好查看反馈回路中的ITH引脚信号，该信号是经过滤波和补偿的控制回路响应。通过增加RC来增加环路的增益，通过降低CC来增加环路带宽。如果RC的增加系数与CC的减少系数相同，则零频率将保持不变，从而在反馈环路的最关键频率范围内保持相移不变...
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2026/8/20 14:58:04
轻载电流操作（突发模式操作、脉冲跳过或强制连续模式）（PLLIN/MODE引脚）LTC3807可以在低负载电流下进入高效突发模式操作、恒定频率脉冲跳过模式或强制连续导通模式。要选择突发模式操作，请将PLLIN/Mode引脚连接到SGND。要选择强制连续操作，请将PLLIN/MODE引脚连接到INTVCC。要选择脉冲跳过模式，请将PLLIN/mode引脚连接到大于1.2V且小于INTVCC−1.3V的直流电压。当控制器启用突发模式操作时，即使ITH引脚上的电压指示较低的值，电感器中的最小峰值电流也设置为最大感测电压的约25%。如果平均电感器电流高于负载电流，误差放大器EA将降低ITH引脚上的电压。当ITH电压降至0.425V以下时，内部睡眠信号变高（启用睡眠模式），两个外部MOSFET均关闭。然后，ITH引脚与EA的输出断开连接，并停在0.450V。在睡眠模式下，大部分内部电路关闭，将LTC3807的静态电流降至仅50μA。在睡眠模式下，负载电流由输出电容器提供。随着输出电压的降低，EA的输出开始上升。当输出电压下降到足够低时，ITH引脚重新连接到EA的输出端，睡眠信号变低，控制器在内部振荡器的下一个周期通过打开顶部外部MOSFET恢复正常运行。当控制器启用突发模式操作时，电感器电流不允许反转。反向电流比较器IR在电感器电流达到零之前关闭底部外部MOSFET，防止其反转并变为负值。因此，控制器以不连续操作的方式运行。在强制连续操作或由外部时钟源计时以使用锁相环的情况下（见频率选择和锁相环部分），允许电感器电流在轻负载或大瞬态条件下反转。与正常操作一样，峰值电感器电流由ITH引脚上的电压决定。在这种模式下，轻负载时的效率低于突发模式操作。然而，连续操作的优点是输出电压纹波较低，对音频电路的干扰较小。在强制连续模式下，输出纹波与负载电流无关。当PLLIN/MODE引脚连接用于脉冲...
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2026/8/20 14:43:13
LTC3807是一款高性能降压开关稳压器DC/DC控制器，可驱动全N沟道同步功率MOSFET级。恒频电流模式架构允许高达750kHz的锁相频率。50μA的空载静态电流延长了电池供电系统的运行时间。OPTI-LOOP®补偿允许在宽范围的输出电容和ESR值上优化瞬态响应。LTC3807具有精确的0.8V参考和电源良好输出指示器。4V至38V的宽输入电源范围涵盖了各种中间总线电压和电池化学成分。LTC3807的输出电压可编程在0.8V至24V之间。TRACK/SS引脚在启动期间使输出电压斜坡化。电流折返限制了短路条件下MOSFET的散热。PLLIN/MODE引脚在突发模式操作、脉冲跳过模式或轻负载下的连续导通模式之间进行选择。特性宽VIN范围：4V至38V（最大40V绝对值）低工作IQ：50μA宽输出电压范围：0.8V≤VOUT≤24VRSENSE或DCR电流传感锁相频率（75kHz至750kHz）可编程固定频率（50kHz至900kHz）轻载时可选择连续、脉冲跳过或低纹波突发模式®操作可选电流限制极低损耗运行：99%占空比可调输出电压软启动或跟踪电源良好输出电压监测器输出过压保护低关断IQ：14μA内部LDO从VIN或EXTVCC为栅极驱动器供电启动期间无电流回退小型20针3mm×4mm QFN和TSSOP封装应用汽车常开系统电池供电的数字设备分布式直流电源系统
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2026/8/20 14:30:53
AD7684是一款16位电荷再分配逐次逼近PulSAR模数转换器（ADC），可在2.7 V至5.5 V之间的单个电源VDD下运行。它包含一个低功耗、高速、16位采样ADC，没有缺失代码，一个内部转换时钟和一个串行SPI兼容接口端口。该部分还包含一个高噪声、宽带宽、短孔径延迟、跟踪和保持电路。在CS下降沿，它对+IN和−IN引脚之间的电压差进行采样。参考电压REF从外部施加，可以设置为电源电压。其功率与吞吐量呈线性关系。AD7684安装在8导联MSOP中，工作温度规定为-40°C至+85°C。特性16位分辨率，无缺失代码吞吐量：100kSPSINL：典型±1 LSB，最大±3 LSB真差分模拟输入范围：±VREF0 V至VREF，两个输入端的VREF高达VDD单电源操作：2.7 V至5.5 V串行接口SPI®/QSPI®-/MICROWIRE™/DSP兼容功率耗散4 mW@5 V2.7伏时为1.5毫瓦2.7V/10kSPS时为150μW待机电流：1nA8导联MSOP封装应用电池供电设备数据采集仪器仪表医疗器械过程控制
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2026/8/20 14:27:06
在电源电压引脚上使用旁路电容器，并在电源线中插入小值电阻器（10Ω至100Ω），以提供系统中各种电路之间的去耦措施，这是一种良好的工程实践。应在电源电压引脚和模拟信号地之间施加0.1μF至1.0μF的陶瓷电容器，以便在AD652上正确旁路。此外，1μF至10μF的较大板级去耦电容器应位于每条电源线上相对靠近AD652的位置。在高分辨率数据采集应用中，这种预防措施是必不可少的，因为人们希望利用AD652的完整线性和动态范围。AD652上提供单独的数字和模拟接地。只有集电极开路频率输出晶体管的发射极和时钟输入阈值返回到数字地。只有5V参考电压连接到模拟接地。两个单独接地的目的是允许高精度模拟信号和电路数字部分之间的隔离。在数字地面上可以容忍很多噪声，而不会影响VFC的精度。当切换与频率输出信号相关的大电流时，这种接地噪声是不可避免的。在高满标度频率下，需要使用约500Ω的上拉电阻器，以获得足够快的上升时间，从而提供明确的输出脉冲。这意味着，例如，从5V逻辑电源中，集电极开路输出消耗10mA。由于电线的自感，如此大的电流被切换会导致长接地线路上的振铃。例如，20号线的电感约为每英寸20nH；在12英寸20号线末端50纳秒内切换10毫安的电流会产生50毫伏的电压尖峰。AD652的单独数字接地很容易处理这些类型的开关瞬态。这些快速瞬变的电磁能辐射引起的干扰仍然是一个问题。通常，电压尖峰是由电感开关瞬态产生的；这些尖峰可以电容耦合到电路的其他部分。另一个问题是由于电线的分布电容和电感导致的地线和电源线的振铃。这种振铃也会将干扰耦合到敏感的模拟电路中。这些问题的最佳解决方案是适当绕过AD652封装处的逻辑电源。1μF至10μF的钽电容器应直接连接到上拉电阻器的电源侧和数字接地引脚12。上拉电阻器应直接连接到频率输出引脚11。旁路电容器和上拉电阻器上的引线长度应尽可能短。电容器提供（或吸收...
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2026/8/20 14:20:23
ADA4665-2是一款轨到轨输入/输出、双通道放大器，针对较低功耗预算设计进行了优化。25°C时，每个放大器的最大电源电流低至400μA；在扩展工业温度范围内，每个放大器的最大电源电流为600μA， 因此该器件非常适合低功耗应用。应用一：铁路到铁路的输入操作ADA4665-2是一款单位增益稳定的CMOS运算放大器，具有轨到轨输入/输出摆动能力，可优化性能。轨到轨输入功能对于保持宽的动态输入电压范围和最大限度地提高两个电源轨的信号摆动至关重要。例如，轨到轨输入功能在输入电压必须覆盖两个电源轨的缓冲应用中非常有用。输入级有两个输入差分对，nMOS和pMOS。当输入共模电压处于输入电压范围的低端时，pMOS输入差分对处于活动状态并放大输入信号。随着输入共模电压的缓慢增加，pMOS差分对逐渐关闭，而nMOS输入差分对打开。这种转变是使用双差分对拓扑的所有轨到轨输入放大器所固有的。对于ADA4665-2，这种转变发生在距离正轨约1 V处，由于差分对的不同偏移电压，导致偏移电压发生变化（见图1和图2）。、图1、2应用二：电流分流传感器许多应用需要感测正极或负极轨道附近的信号。电流分流传感器就是这样一种应用，主要用于反馈控制系统。它们还用于各种其他应用，包括电力计量、电池燃料计量和电动助力转向中的反馈控制。在这些应用中，最好使用电阻非常低的分流器来最小化串联电压降。这不仅最大限度地减少了浪费的电力，而且允许在节省电力的同时测量高电流。ADA4665-2为实现电流分流传感器提供了一种低成本的解决方案。图3、4图3显示了低侧电流传感电路，图4显示了使用ADA4665-2的高侧电流传感线路。使用0.1Ω的典型分流电阻器。在这些电路中，差分放大器将分流电阻器两端的电压降放大100倍。对于真正的差分放大，电阻比的匹配非常重要，其中R1/R2=R3/R4。ADA4665-2的轨对轨功能使...
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2026/8/20 14:08:26
ADCLK854是一款1.2 GHz/250 MHz LVDS/CMOS扇出缓冲器，针对低抖动和低功耗操作进行了优化。可能的配置范围从12个LVDS到24个CMOS输出，包括LVDS和CMOS输出的组合。三条控制线用于确定固定输出块（三排四个）是LVDS还是CMOS输出。ADCLK854提供两个可选输入和睡眠模式功能。IN_SEL引脚状态决定了哪个输入被扇出到所有输出。SLEEP引脚启用睡眠模式以关闭设备。输入端接受各种类型的单端和差分逻辑电平，包括LVPECL、LVDS、HSTL、CML和CMOS。表8提供了每种连接类型的接口选项。该器件采用48针LFCSP封装。它规定在-40°C至+85°C的标准工业温度范围内运行。特性2个可选差分输入可选择的LVDS/CMOS输出最多12个LVDS（1.2 GHz）或24个CMOS（250 MHz）输出每个信道<12 mW（100 MHz操作）54 fs rms综合抖动（12 kHz至20 MHz）100 fs rms附加宽带抖动2.0 ns传播延迟（LVDS）135 ps输出上升/下降（LVDS）70ps输出到输出偏斜（LVDS）睡眠模式引脚可编程控制1.8V电源应用低抖动时钟分布时钟和数据信号恢复电平转换无线通信有线通讯医学和工业成像ATE和高性能仪器
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2026/8/20 14:02:11
ADA4255 是一款带有集成双极电荷泵的精密可编程增益仪器仪表放大器 (PGIA)。ADA4255 具有集成的电荷泵，可在内部产生所需的高压双极电源，以在不降低输入阻抗的情况下，实现宽输入电压范围（典型值为 38 V，VDDCP = 5 V）。ADA4255要求为三个低压电源供电：低压电荷泵电源（VDDCP）、低压模拟输出放大器电源（AVDD）和低压数字电源（DVDD）。低压电荷泵电源内部用于产生高压双极电源VDDH和VSSH，为ADA4255的输入放大器供电。片上高压电源生成允许ADA4255仅使用低压组件进行隔离，同时保持高压、高阻抗的输入操作。典型VDDH和VSSH的方程式如下：VDDH=4.65×VDDCP−0.9VVSSH=-4.65×VDDCP+1.6VVDDH和VSSH被输出到引脚，从而可以施加所需的外部去耦电容。这种解耦不是可选的，是稳定VDDH和VSSH所必需的。图1显示了连接到VDDH和VSSH的最小推荐10μF和0.1μF去耦电容器。在电荷泵时钟默认为16 MHz的情况下，VDDH可以提供高达500μA的额外负载电流，或VSSH可以吸收高达500µA的负载电流。电荷泵频率可以降低到8 MHz，从而降低VDDCP的电流消耗。图1VSSH连接到ADA4255的基板。因此，VSSH必须连接到电路中最负的电源电压，并且VSSH不得超过AVSS。建议使用肖特基二极管将VSSH箝位到AVSS。肖特基二极管在1mA时的正向偏置电压必须为0.3V或更低，并能承受-28V的反向电压。ADA4255监测VDDH和VSSH电源，以检测VDDH或VSSH是否降至8V以下，并设置POR_HV标志。低压模拟输出放大器电源AVDD和AVSS为ADA4255的输出放大器供电。AVSS必须在VSSH−0.3 V至VSSH+30 V和VDDH−30 V至V...
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2026/8/19 16:19:06
AD9751是一款双通道多路复用端口、高速、单通道、10位CMOS DAC。其中集成一个高品质10位TxDAC+内核、一个基准电压源和数字接口电路，采用48引脚小型LQFP封装。AD9751提供出色的交流和直流性能，同时支持高达300 MSPS的更新速率。QAM/PSK合成正交调制（QAM或PSK）由两个基带PAM（脉冲幅度调制）数据信道组成。两个信道均由同一频率载波调制。然而，每个信道的载波彼此相移90°。这种正交性使通过AM传输的数字数据的频谱效率（给定带宽的数据）提高了一倍。接收器可以设计为选择性地选择“同相”和“正交”载波，然后重新组合数据。QAM数据的重组可以映射为表示二维星座中数字字的点，如图1所示。每个点或符号表示在一个符号周期内传输多个比特。通常，I和Q数据信道在数字域中进行正交调制。AD9751的高数据速率允许合成极宽带（>10 MHz）正交载波。图2显示了一个25 M符号/S QAM信号的示例，该信号以200 MSPS的数据速率过采样8，调制到25 MHz载波上，并使用AD9751进行重建。经测量，重建信号的功率为-12.08 dBm。在第一相邻频带中，功率为-73.67 dBm，而在第二相邻频带中功率为-76.91 dBm。图1宽带信号合成的品质因数是发射频带中的信号功率与相邻信道中的功率之比。在图3中，AD9751输出端的相邻信道功率比（ACPR）测量为62 dB。图2进行此类测量的限制通常不是DAC，而是使用计算机工具创建数字数据记录时固有的噪声。为了找出这在多大程度上限制了感知的DAC性能，可以降低信号幅度，如图3所示。随着信号幅度的减小，DAC产生的噪声将保持恒定。当信号幅度降低到噪声基底低于频谱分析仪的水平时，ACPR将以与信号电平降低相同的速率下降。在图2测量的条件下，该点在图29中出现在-4 dBFS处。这表明数据...
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2026/8/19 16:02:59
AD9751产生两个互补的电流输出，IOUTA和IOUTB，可以配置为单端或差分操作。IOUTA和IOUTB可以通过负载电阻器RLOAD转换为互补的单端电压输出VOUTA和VOUTB，如DAC传递函数部分中的方程5至8所述。存在于VOUTA和VOUTB之间的差分电压VDIFF也可以通过变压器或差分放大器配置转换为单端电压。AD9751的交流性能最佳，使用差动变压器耦合输出进行指定，其中IOUTA和IOUTB的电压摆动限制在±0.5 V。如果需要单端单极输出，应选择IOUTA作为输出，IOUTB接地。当AD9751配置为差分操作时，其失真和噪声性能可以得到增强。通过变压器或差分放大器的共模抑制，可以显著减少IOUTA和IOUTB的共模误差源。这些共模误差源包括偶数阶失真产物和噪声。随着重建波形的频率内容的增加，失真性能的增强变得更加显著。这是由于各种动态共模失真机制、数字馈通和噪声的一阶抵消。通过变压器执行差分到单端转换还提供了向负载提供两倍重建信号功率的能力（即，假设没有源端接）。由于IOUTA和IOUTB的输出电流是互补的，因此当进行差分处理时，它们会相加。正确选择的变压器将使AD9751能够为不同的负载提供所需的功率和电压水平。有关各种输出配置的示例，请参阅应用AD9751一节。IOUTA和IOUTB的输出阻抗由与电流源相关的PMOS开关的等效并联组合决定，通常为100kΩ，并联5pF。由于PMOS器件的性质，它也略微取决于输出电压（即VOUTA和VOUTB）。因此，通过I-V运算放大器配置将IOUTA和/或IOUTB保持在虚拟接地，将获得最佳的直流线性。请注意，AD9751的INL/DNL规格是通过运算放大器将IOUTA和IOUTB保持在虚拟接地状态进行测量的。IOUTA和IOUTB也有负电压和正电压合规范围，必须遵守这些范围才能实现最佳性能。-1.0V的负...
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2026/8/19 15:54:52
AD9751是一款双混合端口、超高速、单通道、10位CMOS DAC。它将高质量的10位TxDAC+内核、电压基准和数字接口电路集成到一个48引脚的小型LQFP封装中。AD9751提供交流和直流性能，同时支持高达300 MSPS的更新速率。AD9751已针对高达300 MSPS的超高速应用进行了优化，在这些应用中，数据速率超过了单个数据接口端口DAC的可能速率。数字接口由两个缓冲锁存器和控制逻辑组成。这些锁存器可以通过多种方式与高速DAC进行时间复用。该PLL以两倍于外部时钟的速度驱动DAC锁存器，并能够交织来自两个输入通道的数据。由此产生的输出数据速率是两个输入通道的两倍。在PLL禁用的情况下，可以提供外部2×时钟，并在内部将其除以2。DAC利用分段电流源架构与专有开关技术相结合，以减少毛刺能量并最大限度地提高动态精度。差分电流输出支持单端或差分应用。每个差分输出提供2mA至20mA的标称满标度电流。AD9751采用低成本0.35μm CMOS工艺制造。它的工作电压为3.0V至3.6V，功耗为155mW。产品亮点AD9751是引脚兼容的高速TxDAC+系列的成员，提供10位、12位和14位分辨率。超高速300 MSPS转换率。双10位锁存多路输入端口。AD9751具有灵活的数字接口，允许通过单端口或双端口输入进行高速数据转换。低功率。完整的CMOS DAC功能在3.0V至3.6V单电源的155mW下运行。DAC满标度电流可以降低以实现低功耗操作。片上电压参考。AD9751包括1.20 V温度补偿带隙。
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2026/8/19 15:48:40
LTC4417根据优先级将三个有效电源中的一个连接到公共输出。优先级由引脚分配定义，V1分配最高优先级，V3分配最低优先级。当电源的电压持续在过压（OV）和欠压（UV）窗口内至少256ms时，电源被定义为有效。如果最高优先级有效输入超出OV/UV窗口，则通道立即断开连接，下一个最高优先级有效输出连接到公共输出。两个或多个LTC4417可以级联，以提供三个以上输入之间的切换。LTC4417采用了快速非重叠开关电路，以防止反向和交叉传导，同时最大限度地减少输出下降。栅极驱动器包括一个6V箝位电路，用于保护外部MOSFET。受控输出斜坡功能可最大限度地减少启动涌入电流。开漏VALID输出表明输入电源已在其OV/UV窗口内256ms。特性从三个输入中选择最高优先级的电源阻断反向和交叉传导电流宽工作电压范围：2.5V至36V−42V蓄电池反向连接保护快速切换可最大限度地减少输出电压降低28μA工作电流小于VOUT的电源电流消耗<1μA1.5%输入过压/欠压保护可调过压/欠压滞后P沟道MOSFET栅极保护钳位可级联以提供额外的输入电源24引脚窄SSOP和4mm×4mm QFN封装应用工业手持仪器高可用性系统备用电池系统服务器和计算机外围设备
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2026/8/19 15:36:15
FIFO可以通过写入FIFO配置寄存器FIFO_CFG0和FIFO_CRG1（寄存器0x30和寄存器0x31）来配置。FIFO模式、FIFO条目的数量和通道ID启用都可以配置，以优化各种应用中的性能。FIFO模式ADXL382具有以下FIFO模式：FIFO已禁用正常（也称为最旧保存或第一个N）流（也称为Last N）触发器当FIFO被禁用时（寄存器0x30，比特[5:4]（FIFO_MODE）=0b00），没有数据样本被存储，FIFO读取返回0。当处于正常模式（寄存器0x30，位[5:4]（FIFO_mode）=0b01）时，FIFO会累积数据，直到数据满，然后停止，这由FIFO_full（寄存器0x11，位1）=1表示。只有当从FIFO缓冲区中读取样本并腾出空间时，才会收集额外的数据。当处于流模式（寄存器0x30，比特[5:4]（FIFO_mode）=0b10）时，无论FIFO是否已满，新数据都会连续写入FIFO。当FIFO已满时，最旧的数据集（例如，X、Y、Z和T数据样本）将被丢弃，为新数据集腾出空间。这样，最新的数据总是保存在FIFO缓冲区中。流模式对于减轻主机处理器的负担很有用。在FIFO中收集数据时，处理器可以处理其他任务。当FIFO填充到一定数量的样本时（由寄存器0x30，位0和寄存器0x31，位[7:0]中的FIFO_samples指定），它会触发FIFO水印中断（如果启用此中断）。此时，主处理器可以读取整个FIFO的内容，然后在FIFO再次填充时返回到其他任务。当处于触发模式（寄存器0x30，位[5:4]（FIFO_mode）=0b11）时，FIFO保存触发事件前后的样本。此触发事件可以是活动事件或外部中断。在这种模式下，无论FIFO是否已满，都会连续收集新的数据样本（类似于流模式）。一旦触发事件发生（活动事件或外部中断），FIFO将继续收集一定数量的数据样...
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2026/8/19 15:29:37