片内 VCOAD9522 内置一只片内 VCO，其频率覆盖范围见表 2。校准程序可确保 VCO 的工作电压针对所需频率居中。在首次配置 VCO 环路，以及每次更改标称 VCO 频率时，都必须执行一次 VCO 校准；但一旦完成校准，VCO 便具备足够的调节范围，可在温度和电压极端条件下保持锁定，无需再次校准。为覆盖 VCO 的宽调谐范围，器件内部划分了多个调谐区段。校准过程会自动选择对应所需频率的区段。片内 VCO 由一只片内低压差（LDO）线性稳压器供电。该 LDO 可在一定程度上隔离 VCO，使其不受电源电压波动影响。BYPASS 引脚需通过一只 220 nF 电容接地，以保证 LDO 稳定工作。此 LDO 采用与 ADI anyCAP® 系列稳压器相同的技术，对电容类型不敏感。不允许利用 BYPASS 引脚向外供电。若使用外部 VCO/VCXO，请将 BYPASS 和 LF 引脚悬空，配置见图 41。数字锁定检测（DLD）通过在各引脚的多路复用器中选择正确输出，即可在 LD、STATUS 和 REFMON 引脚获得 DLD 功能。数字锁定检测电路的工作原理：当 PFD 输入上升沿之间的时间差小于设定值（锁定门限）时，指示“锁定”；当该时间差大于另一设定值（失锁门限）时，指示“失锁”。失锁门限宽于锁定门限，从而允许在锁定窗口外存在一定相位误差，而不会使锁定指示产生抖动。锁定检测窗口的时长取决于 CPRSET 电阻值，以及三个寄存器位：数字锁定检测窗口位（寄存器 0x018[4]）反回差脉冲宽度位（寄存器 0x017[1:0]，见表 2）锁定检测计数器（寄存器 0x018[6:5]）表 2 中的锁定/失锁数值基于 CPRSET = 5.11 kΩ；若将 CPRSET 加倍至 10 kΩ，则表中数值亦相应加倍。只有当连续若干个 PFD 周期的时间差均小于锁定门限时，...
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2025/10/28 9:38:30
亚德诺时钟发生器的常见术语解析相位抖动与相位噪声理想的正弦波可以看作相位随时间从 0° 到 360° 连续且均匀地变化。然而，实际信号在相位进展上会表现出一定程度的偏离，这种现象称为相位抖动。尽管相位抖动可能由多种原因引起，但其中一个主要原因是随机噪声，其统计特性服从高斯（正态）分布。这种相位抖动会导致正弦波的能量在频域中扩散，形成连续的功率谱。该功率谱通常以一系列数值表示，其单位为“给定频偏处相对于载波的 dBc/Hz”。该值是 1 Hz 带宽内功率与载波频率处功率之比，并以分贝表示。每次测量时，也会给出相对于载波频率的偏移量。将某一频偏区间（例如 10 kHz 到 10 MHz）内的总功率进行积分是有意义的，这称为该频偏区间内的“积分相位噪声”，并可方便地换算成该频偏区间内由相位噪声引起的时间抖动。相位噪声会对 ADC、DAC 和射频混频器的性能产生不利影响，降低它们可达到的动态范围，尽管影响方式略有不同。时间抖动相位噪声是频域现象；在时域中，同一效应表现为时间抖动。观察正弦波时，各次过零时刻会出现变化；对方波而言，时间抖动表现为边沿偏离其理想（规则）出现时刻。这两种情况中，实际时刻与理想时刻的偏差即为时间抖动。由于这些偏差具有随机性，时间抖动以秒为单位，用均方根（rms）值或高斯分布的 1 σ 表示。DAC 或 ADC 采样时钟上的时间抖动会降低转换器的信噪比（SNR）和动态范围。采样时钟的抖动越低，转换器能达到的性能越高。附加相位噪声附加相位噪声是指可归因于被测器件或子系统的相位噪声量，此时需扣除任何外部振荡器或时钟源的相位噪声。这样便可预测该器件在与各种振荡器和时钟源配合使用时，对系统总相位噪声的影响程度；而每个振荡器或时钟源都会贡献自身的相位噪声。在很多情况下，某一单元的相位噪声会主导系统总相位噪声。当存在多个相位噪声源时，总相位噪声为各贡献...
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2025/10/28 9:34:20
定义MADR-009190-000100是一款四通道驱动器，用于将TTL控制输入转换为GaAs FET微波开关和衰减器的栅极控制电压。高速模拟CMOS技术用于在中高速下实现低功耗，包括大多数微波开关应用。输出高电平可选为0至+2.0V（相对于GND），以优化FET控制器件在低频下的互调产物。对于驱动PIN二极管电路，输出标称在+5V和-5V之间切换。由于输出设备的电阻，当驱动大电流时，实际的驱动器输出电压会较低。特征•高压CMOS技术•四通道•正电压控制•使用TTL输入电平的CMOS器件•低功耗•低成本无铅SOIC-16塑料包装•无卤素“绿色”模塑料•符合RoHS标准
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2025/10/27 10:42:18
定义德州仪器TPS552892 同步降压/升压转换器经优化，可将电池电压或适配器电压转换为电源轨。TPS552892 集成了四个 MOSFET 开关，可为各种应用提供紧凑型解决方案。TPS552892 的输入电压高达 36V。在升压模式下，输入电压为 12V 时，TPS552892 可提供 60W 的输出功率。它能够通过 9V 输入电压提供 45W 的功率。TPS552892 采用平均电流模式控制方案。开关频率可通过外部电阻在 200 kHz 至 2.2 MHz 之间进行编程，并且可与外部时钟同步。TPS552892 还提供展频选项，从而更大限度地减少峰值 EMI。TPS552892 提供输出过压保护、平均电感器电流限制、逐周期峰值电流限制和输出短路保护。TPS552892 还通过可选输出电流限制和断续模式保护，在持续过载情况下确保安全运行。TPS552892 可在高开关频率下使用小型电感器和小型电容器。TPS552892 采用 3.0mm x 5.0mm QFN 封装。特征• 宽输入和输出电压范围– 宽输入电压范围：3.0V 至 36V– 可编程输出电压范围：0.8V 至 22V– ±1% 基准电压精度– 电缆上压降的可调输出电压补偿– ±5% 精密输出电流监测• 在整个负载范围内具有高效率– VIN = 12V、VOUT = 20V 且 IOUT = 3A 时效率为96%– 轻负载状态下的可编程 PFM 和 FPWM 模式• 避免频率干扰和串扰– 可选的时钟同步– 可编程开关频率范围为 200 kHz 至 2.2 MHz• 降低 EMI– 可选可编程扩展频谱– 无引线封装• 丰富的保护特性– 输出过压保护– 利用断续模式实现输出短路保护– 热关断保护– 8A 平均电感器电流限制• 小解决方案尺寸– 开关频率高达 2.2 MHz（最大值）– 3.0mm...
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2025/10/27 10:33:27
AD9755功能结构描述AD9755 由一个 PMOS 电流源阵列组成，能够提供高达 20 mA 的满量程输出电流（IOUTFS）。该阵列分为 31 个相等的电流源，构成最高的 5 位（MSB）。接下来的 4 位（中间位）由 15 个相等的电流源组成，每个电流源的值为 MSB 电流源的 1/16。剩余的最低位（LSB）则是中间位电流源的二进制加权分数。中间位和低位采用电流源而非传统的 R-2R 电阻网络实现，有助于提升多音或低幅度信号的动态性能，并保持 DAC 的高输出阻抗（即 100 kΩ）。所有电流源通过 PMOS 差分电流开关切换至两个输出端之一（即 IOUTA 或 IOUTB）。这些开关基于一种新型架构，显著改善了失真性能。该架构减少了各种时序误差，并为差分电流开关的输入提供了匹配的互补驱动信号。AD9755 的模拟和数字部分拥有独立的电源输入（即 AVDD 和 DVDD），可在 3.0 V 至 3.6 V 范围内独立工作。数字部分可在高达 300 MSPS 的时钟速率下工作，由边沿触发的锁存器和段解码逻辑电路组成。模拟部分包括 PMOS 电流源、相关的差分开关、一个 1.20 V 的带隙电压基准以及一个基准控制放大器。满量程输出电流由基准控制放大器调节，可通过外部电阻 RSET 设置在 2 mA 至 20 mA 之间。该外部电阻与基准控制放大器和基准电压 VREFIO 共同设定基准电流 IREF，该电流以适当的比例复制到分段电流源中。满量程电流 IOUTFS 是 IREF 的 32 倍。参考电压操作AD9755 内置一个 1.20 V 的带隙基准电压源，该基准可以很容易被外部参考电压覆盖，而不会影响性能。REFIO 引脚根据使用的是内部还是外部基准，既可作为输入也可作为输出。若要使用内部基准，只需在 REFIO 引脚与 ACOM 之间接一个 0.1 μF 的去耦电...
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2025/10/27 10:26:49
线性误差（Linearity Error，又称积分非线性 INL）线性误差定义为实际模拟输出与理想输出之间的最大偏差，理想输出是通过从零到满量程的一条直线来确定的。微分非线性（DNL）DNL 是衡量模拟值变化量的指标，归一化到满量程，对应于数字输入码变化 1 LSB 时的输出变化。单调性（Monotonicity）如果随着数字输入的增加，DAC 的输出也增加或保持不变，则该数模转换器是单调的。失调误差（Offset Error）输出电流偏离理想零值的情况称为失调误差。对于 IOUTA，当输入全为 0 时，期望输出为 0 mA；对于 IOUTB，当输入全为 1 时，期望输出为 0 mA。增益误差（Gain Error）实际输出范围与理想输出范围之间的差异。实际范围是通过将输入全设为 1 时的输出减去输入全设为 0 时的输出得到的。输出顺从范围（Output Compliance Range）电流输出型 DAC 输出端允许的电压范围。超出最大顺从范围可能导致输出级饱和或击穿，从而引起非线性性能。温度漂移（Temperature Drift）定义为从常温（25°C）到最低或最高工作温度（TMIN 或 TMAX）之间的最大变化值。对于失调和增益漂移，单位为每摄氏度下满量程范围（FSR）的 ppm（百万分之一）。对于基准漂移，单位为每摄氏度下的 ppm。电源抑制（Power Supply Rejection）在电源电压从最小值变化到最大值时，满量程输出的最大变化量。建立时间（Settling Time）从输出开始跳变起，到其进入并保持在最终值附近某一指定误差带内所需的时间。毛刺脉冲（Glitch Impulse）DAC 中不对称的开关时间会引起不希望的输出瞬态，这种瞬态用毛刺脉冲来量化。其单位为 pV·s（皮伏·秒），表示毛刺的净面积。无杂散动态范围（S...
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2025/10/27 10:23:53
定义AD9755 是一款双端口、复用输入、超高速度、单通道 14 位 CMOS 数模转换器（DAC）。它将一个高质量的 14 位 TxDAC+ 核心、电压基准和数字接口电路集成在一个小型 48 引脚 LQFP 封装中。AD9755 提供卓越的交流和直流性能，支持高达 300 MSPS 的更新速率。AD9755 被优化用于超高速度应用，最高可达 300 MSPS，适用于那些数据速率超过单数据接口端口 DAC 处理能力的情况。其数字接口包括两个缓冲锁存器及控制逻辑。这些锁存器可以通过多种方式以时分复用的方式驱动高速 DAC。该器件内置的锁相环（PLL）可以以两倍于外部时钟的速度驱动 DAC 锁存器，并能够将两个输入通道的数据交错输出，从而使得输出数据速率为输入通道的两倍。如果禁用 PLL，也可以提供一个外部 2 倍时钟信号，由内部进行二分频处理。时钟输入（CLK+/CLK–）支持差分或单端驱动，输入信号幅度可低至 1 V 峰峰值。该 DAC 采用分段式电流源架构，并结合专有的开关技术，以减少毛刺能量并最大化动态精度。差分电流输出支持单端或差分应用。每个差分输出可提供从 2 mA 到 20 mA 的可编程满量程电流。采用低成本 0.35 μm CMOS 工艺制造，工作电压范围为单电源 3.0 V 至 3.6 V，功耗为 155 mW。特征14位双多路复用端口DAC300 MSPS输出更新率出色的SFDR和IMD性能25 MHz输出下的SFDR到奈奎斯特：71 dB内部时钟倍增PLL差分或单端时钟输入片上1.2V参考电压单3.3V电源操作功耗：155 mW@3.3 V48导联LQFP应用通讯：LMDS、LMCS、MMDS基站数字合成QAM和OFDM
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2025/10/27 10:17:05
电流限制（Current Limit）当检测电阻 Rs（VIN 到 SENSE）两端的电压达到 55mV 时，电流限制阈值被触发。在电流限制状态下，GATE 引脚的电压被控制，以限制 MOSFET Q1 中的电流。当电流限制电路激活时，故障定时器也开始工作。如果在故障超时结束前，负载电流降至电流限制阈值以下，LM5069 将恢复正常工作。为确保正常工作，Rs 电阻的值不得超过 100mΩ。断路器（Circuit Breaker）如果负载电流迅速上升（例如负载短路），在电流限制控制环路响应之前，检测电阻 Rs 中的电流可能会超过电流限制阈值。如果电流超过电流限制阈值的两倍（即 105mV/Rs），Q1 将通过 GATE 引脚的 230mA 下拉电流迅速关闭，同时开始故障超时计时。当 Rs 两端电压降至 105mV 以下时，GATE 引脚的 230mA 下拉电流关闭，Q1 的栅极电压将由电流限制或功率限制功能决定。如果在电流限制或功率限制条件解除之前，TIMER 引脚电压达到 4V，Q1 将通过 GATE 引脚的 2mA 下拉电流关闭。功率限制（Power Limit）LM5069 的一个重要特性是 MOSFET 功率限制功能。该功能可用于将 MOSFET Q1 的最大功耗保持在其安全工作区（SOA）额定值内。LM5069 通过监测 Q1 的漏源电压（SENSE 到 OUT）和通过检测电阻（VIN 到 SENSE）的漏电流来计算其功耗。电流与电压的乘积将与通过 PWR 引脚电阻设定的功率限制阈值进行比较。如果功耗达到限制阈值，GATE 电压将被调节，以减少 Q1 中的电流。当功率限制电路激活时，故障定时器也开始工作。欠压锁定（UVLO）当输入电源电压（Vsys）处于可编程的欠压锁定（UVLO）和过压锁定（OVLO）设定范围内时，串联 MOSFET（Q1）被启用。通常，UVLO ...
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2025/10/27 10:09:44
定义TPS22995H-Q1 是一款单通道负载开关，包含 19mΩN 沟道 MOSFET，可在 0.8V 至 5.5V 的输入电压范围内运行，支持的连续电流上限为 3A。该开关由可与低压 GPIO 信号直接连接的开关输入(ON) 控制。TPS22995H-Q1 在开关关闭时具有快速输出放电功能，可将输出电压拉低至已知 0V 状态。此外，该器件还提供可调节上升功能，旨在限制具有高容性负载的浪涌电流。TPS22995H-Q1 的引脚可耐受高湿度条件，这意味着，无论哪个引脚与 GND 或电源之间发生 100kΩ 短路，该器件都能正常运行。时序引脚 (RT) 受高湿度影响时，预计时序保持在 +/-20% 范围内。TPS22995H-Q1 采用 2.8mm × 2.9mm 6 引脚 SOT 封装，间距为 0.5mm。该器件在自然通风环境下的额定运行温度范围为 –40°C 至 +125°C。特征• 符合面向汽车应用的 AEC-Q100 标准：– 温度等级 1: – 40 ° C 至 125 ° C 、 T A• 输入电压范围 (VIN)：0.8V 至 5.5V• 偏置电压 (VBIAS): 1.5V 至 5.5V• 最大持续电流：3A• 导通电阻 (RON)：19mΩ（典型值）• 通过外部电阻器实现可调压摆率控制• 快速输出放电 (QOD)：100Ω（典型值）• 热关断• 耐湿引脚：– 100kΩ 接地短路– 100kΩ 电源短路• ON 引脚智能下拉电阻 (RPD,ON)：• – ON ≥ VIH (ION)：25nA（最大值）– ON ≤ VIL（RPD，ON）：500kΩ（典型值）• 低功耗：– 导通状态 (IQ)：10µA（典型值）– 关闭状态 (ISD)：0.1µA（典型值）应用• 信息娱乐系统• 仪表组•...
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2025/10/27 10:00:53
问：德州仪器OPA690运算放大器如何优化电阻值？答：由于 OPA690 是一个单位增益稳定的电压反馈运算放大器，因此可以使用较宽范围的电阻值作为反馈电阻和增益设定电阻。对这些值的主要限制来自于动态范围（噪声和失真）以及寄生电容的考虑。对于非反相单位增益跟随器应用，反馈连接必须使用一个 25Ω 的电阻，而不能直接短路。这样可以隔离反相输入端的电容与输出引脚之间的耦合，从而改善频率响应的平坦性。通常，在增益 G 1 的应用中，反馈电阻的值应保持在 200Ω 到 1.5kΩ 之间。低于 200Ω 时，反馈网络会对输出端造成额外负载，从而可能降低 OPA690 的谐波失真性能；高于 1.5kΩ 时，反馈电阻上典型的寄生电容（约 0.2pF）可能会在放大器响应中引入意外的带宽限制。一个实用的经验法则是：将 Rf 和 Rg 的并联组合（见图36）控制在约 300Ω 以内。该并联阻抗 Rf || Rg 会与反相输入端的电容相互作用，在反馈网络中引入一个额外的极点，从而在前向响应中形成一个零点。假设反相节点上的总寄生电容为 2pF，保持 Rf || Rg 单独来看，这一约束意味着在高增益情况下，反馈电阻 Rf 可以增大到几千欧姆。这是可以接受的，只要由 Rf 和其并联寄生电容所形成的极点频率保持在所关注频率范围之外即可。
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2025/10/27 9:57:37
由于 OPA690 是一款通用型宽带电压反馈运算放大器，设计者可以使用所有常见的运放应用电路。反相操作是较常见的需求之一，并且具有多项性能优势。图38展示了一个典型的反相配置，其中保留了图36中的输入/输出阻抗和信号增益，但以反相电路形式实现。在反相配置中，有三个关键设计注意事项：增益电阻（Rg）成为信号通道输入阻抗的一部分。如果希望实现输入阻抗匹配（在信号通过电缆、双绞线、长PCB走线或其他传输线导体传输时非常有利），可以将 Rg 设置为所需的终端阻抗值，并通过调整 Rf 来获得所需的增益。这是最简单的方法，能够实现最佳的带宽和噪声性能。然而，在较低反相增益下，所得到的反馈电阻值可能会对放大器输出构成显著负载。例如，对于反相增益为2的情况，若将 Rg 设置为50Ω以实现输入匹配，就不再需要 Rm，但需要选用100Ω的反馈电阻。这样做的一个有趣优势是，当源阻抗为50Ω时，噪声增益变为2——与前一节中考虑的非反相电路相同。然而，此时放大器输出端将看到100Ω的反馈电阻与外部负载并联。一般来说，反馈电阻应限制在200Ω至1.5kΩ之间。在这种情况下，更好的做法是如图38所示，增大 Rf 和 Rg 的值，然后通过一个接地的第三个电阻（Rm）来实现输入阻抗匹配。总的输入阻抗就是 Rg 和 Rm 的并联组合。第二个重要考虑因素，在前一段中已提及，是信号源阻抗会成为噪声增益公式的一部分，并影响带宽。对于图38中的示例，Rm 值与外部的50Ω源阻抗并联，形成一个等效驱动阻抗为：50Ω || 67Ω = 28.6Ω这个阻抗在与 Rg 串联后用于计算噪声增益（NG）。因此，图38中的最终噪声增益为2.8，而如果能像前面讨论的那样去掉 Rm，则噪声增益仅为2。因此，图38中增益为 ±2 的电路带宽略低于图36中增益为2的电路。第三个在反相放大器设计中的重要考虑因素，是设置非反相输入端...
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2025/10/27 9:51:49
用于电压反馈运算放大器的典型差分输入级通常设计为将固定偏置电流导向补偿电容，从而限制了可实现的最大压摆率。OPA690采用了一种新型输入级结构，将跨导元件置于两个输入缓冲器之间，利用它们的输出电流作为前向信号。图36展示了直流耦合、增益为2、双电源供电的电路配置，该配置用作±5V电源下的典型特性测试基础。为了测试目的，输入阻抗通过一个接地电阻设置为50Ω，输出阻抗则通过一个串联输出电阻设置为50Ω。规格中所报告的电压摆幅是直接在输入和输出引脚上测得的，而输出功率（以dBm为单位）则是在匹配的50Ω负载下测得的。对于图36中的电路，总的有效负载为100Ω并联804Ω。禁用控制引脚通常保持开路，以确保放大器正常工作。图36中还包括两个可选元件：一个是串联在非反相输入端的附加电阻（175Ω），与信号源向后看的25Ω直流源阻抗结合，构成一个输入偏置电流抵消电阻，使其与反相输入端所看到的200Ω源阻抗相匹配。除了常见的电源去耦电容接地外，还在两个电源引脚之间加入了一个0.1μF的电容。在实际印刷电路板（PCB）布局中，这个可选的附加电容通常可以将二次谐波失真性能改善3dB至6dB。图37展示了交流耦合、增益为2、单电源供电的电路配置，该配置用作5V电源下的典型特性测试基础。尽管OPA690不是轨到轨（rail-to-rail）设计，但与其他超宽带电压反馈运算放大器相比，它对输入和输出电压的余量要求非常小。在单5V供电下，它可以实现3Vpp的输出摆幅，并保持超过150MHz的带宽。宽带单电源操作的关键要求是保持输入和输出信号摆幅在输入端和输出端的可用电压范围内。图37中的电路通过一个简单的电阻分压器从5V电源建立输入中点偏置（两个698Ω电阻）。输入信号然后通过交流耦合方式接入这个中点电压偏置。输入电压可以在距离任一电源引脚1.5V的范围内摆动，从而提供一个以电源中点为中心、...
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2025/10/27 9:45:28
定义OPA690器件在单位增益稳定、电压反馈运算放大器方面迈出了重要一步。一种新的内部架构提供了以前仅在宽带电流反馈运算放大器中发现的转换速率和全功率带宽。新的输出级架构以最小的净空要求提供高电流。这些因素结合在一起，实现了单电源运行。使用单个5V电源，OPA690可以提供1V到4V的输出摆动，驱动电流超过150mA，带宽为150MHz。这种功能组合使OPA690成为理想的RGB线路驱动器或单电源模数转换器（ADC）输入驱动器。OPA690的5.5mA低电源电流在25°C时精确调整。这种微调以及低温漂移使最大电源电流低于竞争产品。使用可选的禁用控制引脚可以进一步降低系统功率。保持此禁用引脚打开或保持高电平，OPA690正常工作。如果拉低，OPA690电源电流降至100µA以下，同时输出进入高阻抗状态。此功能可用于节能。特征•灵活的供应范围：-5V至12V单电源–±2.5V至±5V双电源•单位增益稳定：500 MHz（G=1）•高输出电流：190mA•输出电压摆动：±4 V•高转换速率：1800 V/µs•低电源电流：5.5mA•低禁用电流：100µA•宽带5V操作：220 MHz（G=2）应用•视频线路驱动器•xDSL线路驱动器和接收器•高速成像通道•ADC缓冲器•便携式仪器•跨阻抗放大器•有源滤波器
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2025/10/27 9:39:38
定义HMC973LP3E是一种吸收式电压可变衰减器（VVA），工作频率为0.5至6 GHz，在必须使用模拟直流控制信号来控制26 dB幅度范围内的射频信号电平的设计中非常理想。它具有由模拟电压Vctrl控制的分流型衰减器。与其他基于GaAs FET的VVA不同，HMC973LP3E在整个控制范围内表现出+35 dBm输入IP3的出色线性。HMC973LP3E是一种单向器件，当RF输入信号施加到RFIN封装引线时，可实现最佳线性性能。HMC973LP3E采用符合RoHS标准的3x3mm QFN无引线封装。特征出色的线性度：+35 dBm输入IP3宽衰减范围：26dB单正电压控制：0至+5V吸收拓扑16引脚3x3mm SMT封装：9mm²应用•点对点无线电•蜂窝/3G和WiMAX/4G基础设施•测试仪器•微波传感器•军事、ECM和雷达
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2025/10/24 10:30:22
定义：PE43610是pSemi一款50Ω、HaRP™技术增强型6位RF数字步进衰减器（DSA），支持9 kHz至13 GHz的宽频率范围。PE43610具有故障安全衰减状态转换功能，支持1.8V控制电压和可选的VSS_EXT旁路模式，以提高杂散性能，使该设备成为测试和测量、点对点通信系统和甚小孔径终端（VSAT）的理想选择。PE43610提供了一个集成的数字控制接口，支持衰减的串行可寻址和并行编程。PE43610的衰减范围为31.5 dB，步长为0.5 dB和1 dB。它能够在13 GHz内保持0.5 dB和1 dB的单调性。此外，如果射频端口上存在0 VDC，则不需要外部隔直电容器。特征•支持9 kHz至13 GHz的宽带•Glitch安全衰减状态转换•灵活的衰减步长为0.5 dB和1 dB，最高可达31.5 dB•+105°C工作温度•具有串行寻址能力的并行和串行编程接口•1 kV的高HBM ESD•封装：24引脚4×4mm LGA应用•测试和测量（T&M）•点对点通信系统•甚小口径终端（VSAT）
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2025/10/24 10:22:36
TI（德州仪器）SN74AHC595设备包含一个8位串行输入、并行输出移位寄存器，该寄存器为8位D型存储寄存器供电。存储寄存器具有并行的3态输出。为移位寄存器和存储寄存器提供单独的时钟。移位寄存器有一个直接覆盖清除（SRCLR）输入、一个串行（SER）输入和一个用于级联的串行输出。当输出启用（OE）输入为高时，除QH′外的所有输出都处于高阻抗状态。特征工作范围：2V至5.5V Vcc8位串行输入、并行输出移位根据JESD 78 II级标准，闭锁性能超过100毫安ESD保护超过JESD 22-2000-V人体模型（A114-A）-200-V机器型号（A115-A）-1000V充电设备型号（C101）应用网络交换机电力基础设施LED显示器服务器
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2025/10/24 10:18:41
定义VNA-28B+是Mini-Circuits一款提供高动态范围的宽带放大器。它采用8引脚5X6 mm MCLP封装，封装面积与SOIC-8引脚封装兼容。VNA-28B+采用PHEMT技术制造。它在RF-in和RF-OUT端口内置了直流块，并配有单独的直流焊盘，无需偏置三通。特征•2.8V和5V操作•无需外部偏置电路•射频输入和输出端的内部直流阻断•高指向性，典型值为16-23dB。•宽带，0.5至2.5 GHz•低噪声系数，典型值为3.0 dB。•输出功率，典型值高达+11.4 dBm。1.5 GHz•VNA-28A+的潜在替代品，见（AN-60-089）•成本低应用•缓冲放大器•蜂窝•PCN
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2025/10/24 10:13:52
Mini-Circuits的ZSW2-63DR+是50Ω 高功率SPDT RF开关专为自动测试设备应用而设计，覆盖5至6000 MHz的宽频范围，具有低插入损耗和高线性度。ZSW2-63DR+采用单引脚控制，在+2.3 V至+4.8 V的单一电源电压下运行。该开关装在坚固、紧凑的铝合金外壳（2.00 x 1.5 x 0.6英寸）中，射频端口有3个SMA-F连接器，还有一个用于直流电源和控制信号的9针D-sub连接器。特征•宽带，5至6000 MHz•高功率+36 dBm•高线性，IP3+73dBm@850兆赫•低损耗，高达6 GHz时为1.1 dB应用•实验室•仪器仪表•自动测试设备（ATE）•防御
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2025/10/24 10:08:52