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BPF-A90+集总LC滤波器的概述及特征应用

2025/8/7 14:00:00
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Mini-Circuits的BPF-A90+型是一种集总LC滤波器,具有良好的插入损耗和高抑制能力。该带通滤波器覆盖74至106MHz。该滤波器具有高Q电容器和电感器,以实现低插入损耗。它在生产批次中具有可重复的性能。

BPF-A90+集总LC滤波器的概述及特征应用

特征

低插入损耗,典型值2.0 dB。

高抑制,典型值64 dB。

宽阻带抑制,高达2000 MHz

微型屏蔽封装

BPF-A90+集总LC滤波器的概述及特征应用

BPF-A90+集总LC滤波器的概述及特征应用

应用

甚高频无线电传输


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    2026-02-06
    设计容纳 AD7606C-18 的 PCB 时,建议遵循以下布局指南:接地平面:如果系统中多个器件需要模数地连接,使用完整的接地平面(不在模拟地和数字地之间分割)接地连接:与接地平面建立稳定连接。避免多个接地引脚共享一个连接。对每个接地引脚使用单个过孔或多个过孔连接到接地平面避免数字线下穿:避免在器件下方走数字线,因为这会将噪声耦合到芯片上。允许模拟地平面在 AD7606C-18 下方运行以避免噪声耦合屏蔽快速开关信号:用数字地屏蔽 CONVST 或时钟等快速开关信号,避免向电路板其他部分辐射噪声,并确保它们不靠近模拟信号路径避免信号交叉:避免数字和模拟信号交叉正交布线:确保电路板上相邻层的走线相互垂直,以减少贯穿电路板的馈通效应电源线设计:确保 AD7606C-18 的 AV_CC 和 V_DRIVE 引脚的电源线使用尽可能大的走线,以提供低阻抗路径并减少电源线上的毛刺效应。尽可能使用电源平面,并在 AD7606C-18 电源引脚和电路板电源走线之间建立稳定连接。对每个电源引脚使用单个过孔或多个过孔去耦电容放置:将去耦电容放置在靠近(理想情况下直接紧贴)电源引脚及其相应接地引脚的位置。将 REFIN/REFOUT 引脚和 REFCAPA 引脚及 REFCAPB 引脚的去耦电容尽可能靠近各自相应的 AD7606C-18 引脚。尽可能将这些电容放置在 AD7606C-18 器件的同一侧为了确保在包含多个AD7606C-18设备的系统中稳定的设备间性能匹配,AD7606C-118设备之间的对称布局非常重要。图 122 显示了 AD7606C-18 PCB 顶层推荐的去耦方式。图 123 显示了底层去耦,用于四个 AV_CC 引脚和 V_DRIVE 引脚的去耦。当 AV_CC 引脚的陶瓷 100 nF 电容放置在靠近各自器件引脚的位置时,引脚 37 和引脚 38 之间可以共享一个...
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    2026-02-06
    AR ADCAD7606C-18 允许 ADC 以 18 位分辨率精确采集满量程幅度的输入信号。所有八路 SAR ADC 在 CONVST 信号的上升沿同时采样各自的输入。BUSY 信号指示转换是否正在进行。因此,当 CONVST 信号的上升沿施加时,BUSY 引脚变为高电平,并在整个转换过程结束时转换为低电平。所有八个通道的转换过程结束由 BUSY 信号的下降沿指示。当 BUSY 信号边沿下降时,下一组转换的采集时间开始。BUSY 信号为高电平时,CONVST 信号的上升沿无效。BUSY 输出变为低电平后,可通过并行或串行接口从输出寄存器读取新数据。或者,如"转换期间读取"部分所述,在 BUSY 引脚为高电平时,可以读取前一次转换的数据。AD7606C-18 包含一个片内振荡器来执行转换。所有 ADC 通道的转换时间为 t_CONV(见下表)。在软件模式下,可以选择通过 CONVST 引脚施加外部时钟。提供低抖动外部时钟可提高大过采样比下的 SNR 性能。将所有未使用的模拟输入通道连接到 AGND。任何未使用通道的结果仍包含在数据读取中,因为所有通道始终被转换。
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    2026-02-06
    AD7849是一款14/16位串行输入乘法DAC数模转换器。该DAC架构可确保拥有出色的微分线性性能;在额定温度范围内,A级产品可保证14位单调性,所有其它等级产品可保证16位单调性。在上电与关断期间(当电源电压变化不定时),VOUT引脚通过一个低阻抗路径箝位在0 V。为避免此时A3的输出短路变为0 V,传输门G1也会打开。这种状况会一直持续到电源稳定下来并向DAC寄存器写入一个有效字,此时G2打开,G1闭合。通过复位输入(RST IN)控制输入,也可以从外部对两个传输门进行控制。例如,如果RST IN输入采用电池监控器芯片驱动,则在关断或掉电时,RST IN输入将变为低电平以开启G1并闭合G2。要重新使能输出,必须重新加载DAC,使RST IN变为高电平。相反地,用户也可以利用片内电压检测器输出(RST OUT)来控制系统的其它部分。AD7849具有一个多功能串行接口结构,可以通过三条线路进行控制,以便于光隔离器应用。SDOUT是片内移位寄存器的输出,能够以菊花链形式使用,对多通道系统中的器件进行编程。此功能由DCEN(菊花链使能)输入控制。BIN/COMP引脚设置DAC编码方式。当BIN/COMP设置为0时,编码方式为标准二进制;设置为1时,编码方式为二进制补码。这样,在单极性和双极性两种输出范围中,用户均可以将DAC复位为0 V。该器件提供20引脚DIP和20引脚SOIC两种封装。因此常常被应用于工业过程控制、PC模拟I/O板以及仪器仪表中。
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    2026-02-06
    输入信号耦合RF 输入(INHI)为单端输入,必须交流耦合。INLO(输入共模)必须交流耦合到地。对于 1 MHz 至 10 GHz 的输入频率,建议耦合电容为 47 nF 陶瓷 0402 封装电容。耦合电容必须安装在靠近 INHI 和 INLO 引脚的位置。耦合电容值可以增加以降低输入级的高通截止频率。高通转角由输入耦合电容和内部 10 pF 高通电容共同设置。INHI 和 INLO 上的直流电压约为 VPOS 以下一个二极管压降。虽然输入可以进行电抗匹配,但通常没有必要。一个外部 52.3 Ω 并联电阻(连接在输入耦合电容的信号侧,如下图所示)与相对较高的输入阻抗相结合,可提供足够的宽带 50 Ω 匹配。耦合时间常数 50 × C_C/2 形成一个高通转角,在 f_HP = 1/(2π × 50 × C_C) 处有 3 dB 衰减,其中 C1 = C2 = C_C。使用典型的 47 nF 值,该高通转角约为 68 kHz。在高频应用中,f_HP 必须尽可能大,以最小化不需要的低频信号的耦合。在低频应用中,出于类似原因,在输入端添加一个简单的 RC 网络形成低通滤波器。该低通滤波器网络通常必须放置在耦合电容的发生器侧,从而降低给定高通转角频率所需的电容值。
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    AD8317 是一款六级解调对数放大器,专为频率高达 10 GHz 的射频测量和功率控制应用而设计。框图如下图所示。AD8317 与 AD8318 对数检波器/控制器共享大部分设计,在 50 dB 范围内保持严格的截距可变性 vs 温度特性。相比 AD8318 的额外改进包括:RF 突发响应时间缩短至 6 ns 至 10 ns电源电流降低至 22 mA电路板空间需求仅为 2 mm × 3 mm这些特性增加了 AD8317 的低成本和高性能优势。采用专有高速 SiGe 工艺的全差分设计扩展了高频性能。INHI 接收标称 500 Ω 并联 0.7 pF 的低频阻抗信号。±1 dB 对数一致性误差的最大输入通常为 0 dBm(参考 50 Ω)。输入的噪声谱密度参考为 1.15 nV/√Hz,相当于在 10.5 GHz 带宽内电压为 118 µV rms,或噪声功率为 -66 dBm(参考 50 Ω)。该噪声谱密度设定了动态范围的下限。然而,AD8317 的低端精度通过对解调传递特性进行特殊整形来增强,以部分补偿内部噪声引起的误差。共模引脚 COMM 为印刷电路板(PCB)接地提供高质量的低阻抗连接。封装焊盘内部连接到 COMM 引脚,也必须接地到 PCB,以减少从芯片到 PCB 的热阻抗。对数函数通过六级联增益级以分段方式近似。(有关对数近似的更全面解释,请参阅 AD8307 数据手册。)每级具有标称 9 dB 的电压增益和 10.5 GHz 的 3 dB 带宽。通过精密偏置,增益在温度和电源变化范围内保持稳定。由于增益级的级联特性,总增益很高。包含一个失调补偿环路,以校正级联单元内的失调。在每个增益级的输出端,使用平方律检波器单元对信号进行整流。RF 信号电压被转换为波动的差分电流,其平均值随信号电平增加而增加。除六级增益级和检波器单元外,AD83...
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