SKY13351-378LF是一款pHEMT GaAs FET I/C开关。通过使用低损耗路径（即施加到VCTL1或VCTL2引脚的正电压）将RF公共端口（INPUT，引脚5）连接到OUTPUT1或OUTPUT2端口（分别为引脚1或3），该开关可用于传输/接收应用。该开关在隔离端口上是“反射短路”的。该开关采用紧凑的1 x 1 mm、6个不精确焊盘塑料微引线框架封装双（MLPD）封装制造。参数信息正电压控制（0和1.8 V至0和5.0 V）宽带频率范围：20 MHz至6.0 GHz非常低的插入损耗，2.45 GHz时典型为0.35 dB高隔离度，2.45 GHz时典型为24 dB出色的线性性能，IP0.5dB=+30 dBm超微型MLPD（6针，1 x 1毫米）封装（MSL1，260℃符合JEDEC J-STD-020）常被应用在哪些应用中？WLAN 802.11 a/b/g/n网络WLAN中继器ISM频段无线电低功耗发射接收系统SKY13351-378LF引脚图
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2026/1/26 10:11:28
ADAU1361 是一款高音质、低功耗、小封装的音频编解码器。其立体声 ADC 与立体声 DAC 的信噪比均 ≥ +98 dB，总谐波失真加噪声 ≤ –90 dB。串行数据端口兼容 I²S、左对齐、右对齐及 TDM 格式，方便与各类数字音频接口对接。工作电压 1.8 V – 3.65 V，片内稳压器产生内部数字电源。录音通路支持差分/单端模拟麦克风以及数字麦克风输入；麦克风偏置引脚可直接为驻极体麦克风供电。输入配置最多可接 6 路单端模拟信号，也可组合成立体声差分或立体声单端，外加 2 路辅助单端输入。每路输入均带独立可编程增益放大器（PGA），可直接跳线到播放混音器，绕过 ADC。还可启用自动电平控制（ALC），保持录音音量恒定。ADC 与 DAC 均为高品质 24 位 Δ-Σ 调制器，可选 64× 或 128× 过采样率。转换器的基础采样率由输入时钟决定，并可通过控制寄存器进一步分频，支持 8 kHz – 96 kHz 采样频率。ADC 与 DAC 均内置步进极细的数字音量控制。播放通路可将输入信号与 DAC 输出灵活混音，支持多种输出组合：立体声耳机驱动（可免电容，用 mono 输出作虚拟地）其余引脚可差分驱动听筒立体声线路输出可配置成单端/差分，也可混音成单声道片内分数 PLL 接受 8 MHz – 27 MHz 任意输入时钟，产生所需内部时钟。芯片采用 32 引脚 5 mm × 5 mm LFCSP 小型封装，底部带裸露焊盘。
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2026/1/23 11:39:28
一、定义ADAU1361 是一款低功耗立体声音频编解码器，在 1.8 V 模拟供电下仅需 14 mW 即可实现 48 kHz 立体声录放。其立体声 ADC 与 DAC 支持 8 kHz–96 kHz 采样率，并内置数字音量控制，非常适合电池供电的音频及语音应用。录音通路集成麦克风偏置电路，提供 6 路输入，可在 ADC 前混音或选择旁路；并支持立体声数字麦克风输入。芯片内置 5 路大功率输出驱动器（2 路差分 + 3 路单端），可驱动立体声耳机、听筒或其他换能器，支持交流耦合或免电容架构，所有模拟输出均带独立细调电平控制，输出混音级可实现灵活音频路由。控制接口支持 I²C 与 SPI；音频串行总线可配置为 I²S、左对齐、右对齐及 TDM 模式。可编程 PLL 支持 8 MHz–27 MHz 任意整数或分数主时钟，产生所有标准音频时钟。二、具备的特征24-位立体声音频ADC和DAC：信噪比98 dB采样率从8kHz到96kHz低功耗：7 mW记录，7 mW播放，48 kHz，1.8 V6 模拟输入引脚，可配置为单端或差分输入灵活的模拟输入/输出混频器立体声数字麦克风输入模拟输出：2个差分立体声、2个单端立体声、1个单声道耳机输出驱动器PLL支持8 MHz至27 MHz的输入时钟模拟自动电平控制（ALC）麦克风偏置参考电压模拟和数字输入/输出：1.8 V至3.65 V数字音频串行数据I/O：立体声和时分复用（TDM）模式软件可控无点击静音软件断电32-引线，5mm×5mm LFCSP−40工作温度范围为°C至+85°C三、常见的应用智能手机/多媒体手机数码静态相机/数码摄像机便携式媒体播放器/便携式音频播放器手机配件产品
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2026/1/23 11:31:36
AD9864是一款通用中频子系统，可对信号带宽范围为6.8 kHz至270 kHz的低电平10 MHz至300 MHz中频输入进行数字化处理。AD9864的信号链包括一个低噪声放大器(LNA)、一个混频器、一个带通Σ-Δ型模数转换器(ADC)以及一个具有可编程抽取系数的抽取滤波器。与 DSP 的接口AD9864 可直接与 Analog Devices 的可编程数字信号处理器（DSP）相连。下图以 Blackfin® 系列（如 ADSP-BF609）为例：该系列 16-bit DSP 针对低功耗通信应用优化，具备动态电源管理，非常适合便携式无线产品。全家族代码兼容，兼具高性能、低功耗和微控制器式易用指令集。如上图所示：AD9864 的同步串行接口（SSI）把接收数据流送到 DSP 的串行口（SPORT）。芯片设置与寄存器编程通过 DSP 的 SPI 端口完成；使用独立片选线（SEL），一个 SPI 口即可对多片 AD9864 进行读写。相关 DSP 驱动代码可在 AD9864 产品页面下载。
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2026/1/23 11:27:40
使用 SYNCB 实现同步许多应用需要将一片或多片 AD9864 同步，使其输出数据与某一外部异步信号精确对齐。例如：采用分集接收的系统，常要求多片 AD9864 的数字输出同步；卫星通信 TDMA 载荷，需在突发间隔重新同步，以补偿参考频偏和多普勒效应。SYNCB 为低电平有效信号，可清零抽取滤波器和 SSI 端口内的时钟计数器（时钟综合器计数器不复位，因默认多片 CLK 已相连）。SYNCB 同时复位调制器，产生一个大幅脉冲，该脉冲需经数字滤波与 SSI 格式电路传播后，输出数据才恢复正常。因此，SYNCB 变高后第 2 个数据样点起即可得到不受该脉冲影响的有效数据（与抽取因子无关）。由于 SYNCB 会复位调制器，务必在完成带通 Δ-Σ ADC 调谐后的初始化阶段再使用。若需周期性、与 FS 同步的 SYNCB，建议在其上升沿之后、下一 FS 脉冲前 3 个 CLKOUT 周期处拉低 SYNCB，避免产生窄脉冲而干扰主机 DSP/FPGA。未用时须将 SYNCB 上拉至逻辑高，片内无上拉电阻。上图给出 SYNCB 与 CLKOUT、FS 的时序关系：当片内时钟综合器产生 ADC 时钟时，SYNCB 为异步低有效，低电平持续时间 ≥ 1/(2×fCLK)；SYNCB 为低期间 CLKOUT 保持高，FS 保持低；SYNCB 回到高后，CLKOUT 在 1–2 个输出时钟周期内重新有效。若由外部提供 ADC 时钟且 SYNCB 与之为同步信号，建议 SYNCB 在 CLKIN 下降沿跳变，以保证 CLKOUT 相对于 SYNCB 上升沿的延迟一致。FS 将在若干输出时钟周期后重新出现，具体延迟由数字滤波器抽取因子和 SSIORD 设置决定；对于任意抽取因子与 SSIORD，该延迟固定且可重复。验证多片同步时，可监测各 AD9864 的 FS 信号是否对齐。
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2026/1/23 11:24:48
同步串行接口（SSI）AD9864 可通过 SSI 高度定制输出数据格式、控制信号与时序参数，以适配不同数字接口。3 线模式：提供帧同步 FS、时钟 CLKOUT、串行数据 DOUTA。2 线模式：帧同步信息嵌入数据流，仅输出 CLKOUT 与 DOUTA。相关寄存器：SSICRA、SSICRB、SSIORD（位定义见表 8–13,见文末附件图）。芯片主输出为经数字下变频后的 I/Q 基带信号，以串行帧形式从 SSI 端口送出。帧速率 = 调制时钟 fCK ÷ 抽取因子（寄存器 0x07）。帧格式：先 I 字后 Q 字，每字 24 bit 或 16 bit，二进制补码，MSB 在前。帧尾可附加两个字节：字节 1：8 bit AGC 衰减量（0=0 dB，255=24 dB）字节 2：2 bit 复位计数 + 6 bit 接收信号强度估计（RSSIL）下图给出了多种 SSI 模式下的帧结构。可选字节细节仅当 SSICRA 的 EAGC 位置 1 时附加字节才输出。首字节：8 bit 衰减值次字节：2 bit 自上次报告以来的调制器复位事件数（饱和值 3），6 bit RSSIL（线性估计，60 对应满幅信号）若 SSICRA 的 AAGC 位为 0，两字节合并为 16 bit 字紧随 Q 字之后；若 AAGC=1，则进入“交替 AGC 数据模式”：含衰减字节 LSB=0含复位/RSSI 字节 LSB=1两字节交替出现。2 线模式将 SSICRA 的 EFS 位置 1 即启用嵌入式帧同步。每 8 bit 数据前后分别插入 1 bit 起始（低）与 1 bit 停止（高），帧尾至少 10 个高电平。FS 引脚根据 SFST 位决定保持低电平或高阻（默认）。其它控制位：SFSI：帧同步极性反转SLFS：帧同步延迟 1 时钟周期（EFS=1 时无效）SCKI：时钟极性反转S...
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2026/1/23 11:14:33
应用信息一：电流输出型 DAC 接口AD694 可方便地与电流输出 DAC（如 AD566A）连接，构成数字量→4-20 mA 接口，见下图。AD694 为 DAC 提供所需基准电压和缓冲放大器，仅需简单连线即可完成。AD694 的 10 V 基准给 AD566 做参考。缓冲放大器利用 DAC 内部电阻将满量程电流转换成 +10 V，因此 AD694 被设为 10 V 满量程输入。10 pF 电容用于补偿 DAC 的 25 pF 输出电容。可选 100 Ω 微调电阻（RTRIM）可校准满量程；若无需校准可用 50 Ω，精度典型值 ±1 LSB，且不影响 4 mA 零点。接地管理：AD694 的 9、3 脚与 AD566 的 3、7 脚连线尽量短，并单点接至 AD694 5 脚附近的星形地；AD566 的 12 脚功率地必须单独引到星形地。4-20 mA 输出（11 脚）需有返回功率地的路径，具体可接功率地或 15 V 电源，视负载大小与功耗而定。应用信息二：单电源数字→4-20 mA 接口仅用 15 V 单电源即可实现 12 位数字输入→4-20 mA 输出。DAC 工作于“电压开关模式”：当 DAC 基准 2.5 V 时，输出电压 0-VREF 与数字码成正比。AD694 基准设为 2 V，输入级设 2 V 满量程；输入缓冲器隔离 DAC 电压输出。全量程数字码对应 20 mA，全零码对应 4 mA。AD694 基准负载随码值变化，电路响应速度受基准动态特性限制。AD7541A 的电源应紧贴 15 V；若 VS 明显低于 15 V，DAC 微分非线性会恶化。某些应用希望 4-20 mA 输出具有 ±5 % 的超量程能力，即 DAC 全范围对应 3.2-20.8 mA。实现方法：在缓冲放大器外加 1.1 倍增益，把 AD694 跨度扩大 10 % → 1...
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2026/1/23 11:06:42
AD9788直接上变频调制器应用信息低通滤波器直接上变频架构越来越多地被用于基站发射机。附图展示了如何利用ADI器件构建该系统：采用AD9788 TxDAC®与ADL5375组合。AD9788为双通道集成DAC，增益/失调温度漂移仅±2% FSR与±0.001% FSR，可最大限度减小信号链路误差。本振(LO)由ADF4351提供；低通滤波器使用ADIsimPLL™设计，信道间隔200 kHz，闭环带宽35 kHz。ADL5375的LO端口可由ADF4351的互补RFoutA±输出差分驱动，性能优于单端驱动，并省去单端转差分的Balun。该配置下，LO典型积分相位噪声(100 Hz–5 MHz)为0.61° rms。ADL5375接受-6 dBm至+6 dBm的LO功率；ADF4351可软件设置每路输出-4 dBm至+5 dBm，方便取得最佳LO电平。RF输出设计为驱动50 Ω负载，但必须交流耦合(见附图)。当I、Q输入为2 V p-p正交信号时，ADL5375调制器输出功率约2 dBm。附图：
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2026/1/23 10:54:30
安全注意事项LTM4636 在 VIN 与 VOUT 之间未提供电气隔离，且内部无熔断器。如需保护，应在每路输入端串接一只“慢断”型保险丝，其额定电流取最大输入电流的两倍，以防止灾难性故障。当内部顶层 MOSFET 发生短路失效时，关断信号无法消除过压，底层 MOSFET 会持续导通试图保护负载。此时输入电源将通过失效的顶层管和持续导通的底层管向地注入极大电流，可能导致严重发热与 PCB 损坏。因此应选用保险丝或断路器作为二级保护，把故障电流限制在安全范围。LTM4636 具备前文所述的增强型过温保护布局检查清单 / 示例LTM4636 高度集成，使 PCB 布局非常简单，但仍需遵循以下要点以获得最佳电气与热性能：为大电流路径（VIN、GND、VOUT）保留大面积铜箔，可减小传导损耗与热应力。将高频陶瓷输入、输出电容尽量靠近 VIN、GND、VOUT 引脚放置，以抑制高频噪声。在器件正下方布置独立的地电源层。为降低过孔传导损耗并减小模块热应力，请用多个过孔连接顶层与其他电源层。不要在焊盘正中央直接打未塞孔的过孔；若必须打，应做树脂塞孔或电镀覆盖。在信号引脚处放置测试点，便于调试。为与信号引脚相连的外围器件设置独立 SGND 铜区，并在器件下方单点连接 SGND 与功率地。多颗并联时，把 COMP 与 VFB 引脚用内电层就近短接在一起。用 RsNUB、CsNUB（2.2 Ω、2200 pF）吸收开关节点振铃。下图给出了推荐的布局范例。
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2026/1/22 11:57:01
突发模式（Burst Mode）LTM4636 支持突发模式：根据负载需求间歇开关功率 MOSFET，降低静态电流。若应用要求在极轻载时效率最高，可将 MODE_PLLIN 引脚浮空使能该模式。突发期间，即使 COMPA 电压显示较低，电感峰值电流仍被设定为正常最大值的约 30%。当电感平均电流超过负载需求，COMPA 电压下降；一旦低于 0.5 V，突发比较器翻转，内部休眠信号变高，关断两只功率 MOSFET。休眠模式下，部分内部电路被关闭，静态电流降低，负载电流由输出电容提供。当输出电压跌落、COMPA 电压回升，休眠信号变低，LTM4636 恢复正常工作，下一个振荡周期再次导通顶侧 MOSFET，循环重复。脉冲跳跃模式若希望在中间负载时兼顾低输出纹波与较高效率，可将 MODE_PLLIN 接 INTVCC 进入脉冲跳跃模式。轻载时内部电流比较器可能连续数个周期保持翻转，从而跳过若干开关周期。该模式纹波低于突发模式，且工作频率更高。强制连续模式若应用更关注固定频率、最低输出纹波而非轻载效率，可将 MODE_PLLIN 接地启用强制连续模式。此时轻载允许电感电流反向，COMPA 全程控制电流比较器阈值，每个振荡脉冲均导通顶侧 MOSFET。启动阶段该模式被禁止，直至输出电压稳定后才允许电流反向。
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2026/1/22 11:52:13
一、定义LTM4636 是一款 40 A 降压型 μModule（电源模块）开关稳压器，采用堆叠电感兼做散热器，可在小封装内实现更快散热、更低温升。裸露的电感允许来自任意方向的气流直接带走热量。在 12 V 输入、1 V 输出、40 A 负载、200 LFM 风冷条件下，LTM4636 仅比环境温度高 40 °C 即可输出 40 W 满载功率；环境温度 83 °C 时仍可满功率运行，110 °C 时支持半功率 20 W。效率表现：12 V 输入、1 V 输出时，分别输出 15 A、30 A、40 A 电流，效率分别为 92 %、90 %、88 %。该 μModule 支持并联均流，四颗并联可输出 160 W，仅 40 °C 温升，效率仍达 88 %（12 V 输入、1 V 输出、400 LFM）。LTM4636 采用 16 mm × 16 mm × 7.07 mm BGA 封装。二、具备的特征堆叠电感器充当散热器宽输入电压范围：4.7V至15V0.6V至3.3V输出电压范围线路、负载和温度（-40°C至125°C）上的总直流输出电压误差为±1.3%用于精确调节的差分遥感放大器电流模式控制/快速瞬态响应频率同步并联均流（高达240A）内部或外部补偿40A时效率为88%（12VIN，1VUT）过电流折叠保护16mm×16mm×7.07mm BGA封装三、常见的应用电信服务器和网络设备工业设备和医疗系统
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2026/1/22 11:45:23
AD7693 是一款快速、低功耗、单电源、高精度 16 位 模数转换器ADC，采用逐次逼近架构。芯片最高采样速率 500 kSPS，两次转换之间自动进入掉电模式；当采样率 1 kSPS 时典型功耗仅 40 μW，极适合电池供电应用。片内集成采样-保持电路，无流水线延迟或latency，特别适用于多路复用通道系统。工作电压 4.5 V–5.5 V，数字接口可接 1.8 V–5 V 任意逻辑系列，10 引脚 MSOP 封装。与 16 位 AD7687/AD7688 及 18 位 AD7690/AD7691 引脚完全兼容。转换器工作原理AD7693 是基于电荷再分配 DAC 的逐次逼近 ADC。上图为其简化原理图：电容 DAC 由两组各 16 只二进制加权电容构成，分别接至比较器两个输入端。电容阵列连接比较器输入的一端通过 SW+、SW- 接地，所有独立开关接至模拟输入端，于是电容阵列充当采样电容，在 IN+ 与 IN- 端获取模拟信号。转换阶段当采样结束且 CNV 变高后，转换开始：先断开 SW+、SW-；电容阵列脱离输入端并接地，于是采样结束时 IN+ 与 IN- 之间的差分电压被施加到比较器输入，使比较器失衡。控制逻辑按二进制权重（VREF/2、VREF/4 … VREF/32768）依次将电容阵列各单元在 GND 与 REF 之间切换，从 MSB 开始逐步使比较器重新平衡。过程结束后返回采样阶段，控制逻辑产生 ADC 输出码及忙标志。由于片内自带转换时钟，转换过程无需外部串行时钟 SCK。
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2026/1/22 11:42:02
一、定义AD7693 是一款 16 位逐次逼近型模数转换器（ADC），采用单电源 VDD 供电。芯片集成低功耗、高速、无失码的 16 位采样 ADC，内置转换时钟和多功能串行接口。基准电压 VREF 由外部提供，最高可设至 VDD。在 CNV 上升沿，器件对 IN+ 与 IN– 引脚之间的电压差进行采样；两引脚电压以 VREF/2 为中心，反相摆动于 0 V 与 VREF 之间。功耗与吞吐速率成线性关系。通过 SDI 输入，兼容 SPI 的串行接口支持在单根 3 线总线上级联多颗 ADC，并可提供可选的忙状态指示。芯片使用独立的 VIO 供电，可与 1.8 V、2.5 V、3 V 或 5 V 逻辑兼容。AD7693 采用 10 引脚 MSOP 封装，工作温度范围 −40 °C 至 +85 °C。二、具备的特征• 16位分辨率、无失码• 吞吐速率：500 kSPS• INL/DNL：典型值±0.25 LSB，最大值±0.5 LSB（FSR的±8 ppm）• 动态范围：96.5 dB• 信纳比(SINAD)：96 dB(1kHz)• 总谐波失真(THD)：-120 dB(1 kHz)• 真差分模拟输入范围：±VREF 0 V至 VREF（两个输入上的VREF均可高达VDD）三、常见应用电池供电设备数据采集地震数据采集系统数字视频管理系统仪器仪表医疗器械
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2026/1/22 11:36:41
ADMV4680 是一款 Ku 频段半双工波束成形芯片。芯片集成单端口网络接口（收发共用）、四路功分器（收发各一）以及收发切换开关，用于隔离发射与接收通路。中央数字控制器可逐通道调节增益与相位。在四通道配置下，接收通路将四路相位调整后的信号合并至公共 RF 端口。发射模式下，四通道芯片把公共 RF 端口的信号分配至四个天线端口，并对每路增益/相位进行独立调整；收发信号可与其他波束成形芯片叠加，构成完整相控阵天线。ADMV4680 在四个输出端各集成功率检测器，可单独关断以节省功耗；片内温度传感器精度优于 ±10 °C。接收模式：在 12.7 GHz、25 °C 条件下，含片外输入匹配网络的典型噪声系数为 1.9 dB，典型功耗 78 mW。发射模式：典型输出 1 dB 压缩点 9.5 dBm，典型功耗 108 mW。增益与相位可编程，支持 6 位/8 位相位分辨率，最少需 72 个 SPI 时钟周期完成配置。具备的特征4通道T/RSPI控制和单引脚T/R控制最多32个波束形成器芯片的通用SPI总线集成功率检测器倒装芯片设计3.19mm×2.49mm模具尺寸因此常被应用于10 GHz至15 GHz卫星通信系统中。附：ADMV4680功能图
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2026/1/22 11:31:08
ADRF5040是一款通用、宽带高隔离度、非反射式单刀四掷(SP4T)开关，采用LFCSP表贴封装。该开关频率范围为9 kHz至12.0 GHz，具有高隔离度和低插入损耗。其操作原理如下：ADRF5040 需在 VPP 引脚施加正电源电压，在 VSS 引脚施加负电源电压。建议在电源线上加旁路电容，以减小 RF 耦合。器件通过两个数字控制电压（分别加在 V1 和 V2 引脚）进行切换。为改善 RF 信号隔离，建议在这两条数字信号线上加小值旁路电容。ADRF5040 在 RF 输入端口（RFC）和四个 RF 输出端口（RF1～RF4）内部已匹配至 50 Ω，无需外部匹配元件。RF1～RF4 引脚为直流耦合，因此各 RF 路径必须加直流隔直电容。设计为双向，输入与输出可互换。ADRF5040 无需特殊上电时序，VPP 与 VSS 的相对上电顺序无关紧要。但 V1、V2 控制信号只能在 VPP 上电之后施加，以防止内部 ESD 保护电路正偏损坏。待器件电源稳定后再开启 RF 信号。
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2026/1/22 11:29:14
差分输入网络当差分 CVBS 视频信号接入 ADV7182 的 AIN 引脚时，请使用上图所示的输入网络。建议将该输入网络尽可能靠近 ADV7182 的 AIN 引脚放置。差分视频传输通过发送两路互补的 CVBS 信号实现，与单端传输相比具有多项显著优势：天然抑制小信号与大信号噪声改善 EMI 性能能够吸收地弹干扰电阻 R1 为差分 CVBS 输入线提供射频终端匹配：伪差分 CVBS 输入时，R1 建议取 75 Ω全差分 CVBS 输入时，R1 建议取 150 Ω1.3 kΩ 与 430 Ω 电阻构成分压器，增益为 0.25，在衰减输入模拟视频幅度的同时，把 ADV7182 的输入共模范围扩展至最高 4 V（峰峰值）。注意：ADV7182 内部放大器会恢复信号幅度，因此信噪比性能不受影响。100 nF 交流耦合电容在信号进入 ADV7182 模拟输入引脚前去除直流偏置；片内钳位电路在信号送入 ADC 前将其直流偏置恢复至最优电平。1.3 kΩ、430 Ω 电阻与 100 nF 电容的组合还可在“对电池短路”（STB）事件中限制流入 ADV7182 的电流。为获得最佳性能，1.3 kΩ 与 430 Ω 电阻应严格匹配：所有对应电阻需采用相同且尽可能低的阻值容差。
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2026/1/22 11:23:23
标准清晰度视频处理器概览ADV7182 能够解码大量基带视频信号，支持复合（单端与差分）、S-Video 和分量格式。视频处理器支持的标准包括：PAL B/D/I/G/H、PAL 60、PAL M、PAL N、PAL Nc、NTSC M/J、NTSC 4.43，以及 SECAM B/D/G/K/L。芯片可自动检测视频制式并相应处理。ADV7182 内置五行超自适应 2D 梳状滤波器，在解码复合视频时可实现优异的色度/亮度分离。该高自适应滤波器无需用户干预，即可根据视频制式和信号质量自动调整处理模式。用户还可通过芯片调节亮度、对比度、饱和度及色调。ADV7182 采用专利 ADLLT™（自适应数字行锁跟踪）算法，可跟踪 VCR 等源产生的变化行长度。ADLLT 使其能够解码 VCR、调谐器输出、VCD 机及摄像机等低质量或噪声源信号。ADV7182 包含色度瞬态增强（CTI）处理器，可锐化色度过渡边沿，使垂直过渡更加清晰。ACE（自动对比度增强）算法通过自动调整对比度级别来提升画面细节：可在不使亮区过曝的前提下提高暗部对比度，这对需分辨阴影区域物体的车载应用尤为实用。8 位→6 位抖动降位功能便于驱动标准 6 位 LCD 屏。视频处理器支持多种 VBI 数据业务：隐藏字幕（CCAP）、宽屏信令（WSS）、复制生成管理系统（CGMS）以及全球标准图文电视（WST）数据切片。相关信息以辅助数据包（ANC）形式通过 8 位视频输出端口传输。ADV7182 通过 Macrovision 完整认证，检测电路可识别并上报 I/II/III 级保护。解码器对所有 Macrovision 信号输入均具备完全鲁棒性。
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2026/1/22 11:15:02
ADV7182 可自动检测并将符合全球 NTSC、PAL 和 SECAM 标准的标准模拟基带视频信号转换为 4:2:2 分量视频数据流。该视频数据流兼容 8 位 ITU-R BT.656 接口标准。外部 HS、VS 和 FIELD 信号可为 LCD 控制器及其他视频 ASIC 提供时序基准。其精确的 10 位模数转换可为消费应用提供专业级视频性能，实现真正的 8 位数据分辨率。模拟视频输入端支持单端、伪差分和全差分复合视频信号，以及 S-Video 和 YPbPr 分量信号，可兼容广泛的消费类和汽车视频源。ADV7182 配合外部分压电阻可提供 4 V 的共模输入范围，从而消除视频线路上存在的大信号共模瞬变。无需外部放大电路即可实现高达 80 dB 的共模抑制（CMR）。片内 AGC 与钳位恢复电路可将输入视频信号的峰峰值放大至 ADV7182 模拟输入引脚所需的 1.0 V；也可被旁路以使用手动设置。标准交流耦合电容即可保护 ADV7182 免受“对电池短路”（STB）事件的损害。ADV7182 通过两线串行双向端口（兼容 I²C）进行配置，采用 1.8 V CMOS 工艺制造。单芯片 CMOS 结构在确保更高功能集成度的同时降低了功耗。器件采用节省空间的 LFCSP 表面贴装、RoHS 兼容封装。提供汽车级版本（−40 °C 至 +105 °C），适用于汽车应用；亦有工业级版本（−40 °C 至 +85 °C），适用于工业场景。ADV7182 是一款多功能单芯片多制式视频解码器，可自动识别 PAL、NTSC 和 SECAM 标准的复合、S-Video 和分量视频信号，支持单端或差分复合信号输入，特别适合车载应用。它将上述模拟视频格式转换为 8 位 ITU-R BT.656 数字视频流，可无缝连接各类 MPEG 编码器、编...
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2026/1/22 11:10:52